一、基本邏輯門(mén)概述
在數(shù)字電路中，與門(mén)、或門(mén)和非門(mén)是最常見(jiàn)的邏輯門(mén)類(lèi)型，它們構(gòu)成復(fù)雜電路的基礎(chǔ)。
二、與門(mén)（AND Gate）
功能描述 ：僅當(dāng)所有輸入均為高電平（邏輯 1）時(shí)，輸出才為高電平（邏輯 1）。
符號(hào)表示 ：通常用 “∧” 或 “&” 符號(hào)表示與門(mén)邏輯運(yùn)算。
真值表現(xiàn) ：在與門(mén)的真值表中，只有當(dāng)所有輸入均為 1 時(shí)，對(duì)應(yīng)的輸出才為 1，其余情況輸出均為 0。表 1 展示了兩輸入與門(mén)的真值表。
表 1 兩輸入與門(mén)真值表
三、或門(mén)（OR Gate）
功能描述 ：只要至少一個(gè)輸入為高電平（邏輯 1），輸出就為高電平（邏輯 1）。
符號(hào)表示 ：一般采用 A|B或A∨B 符號(hào)表示或門(mén)邏輯運(yùn)算。
真值表現(xiàn) ：從或門(mén)的真值表來(lái)看，只要輸入中存在至少一個(gè) 1，輸出即為 1，僅當(dāng)所有輸入都為 0 時(shí)，輸出才為 0。表 2 為兩輸入或門(mén)的真值表。
表 2 兩輸入或門(mén)真值表
四、非門(mén)（NOT Gate）
功能描述 ：輸出電平與輸入電平相反，實(shí)現(xiàn)邏輯否定功能。
符號(hào)表示 ：
真值表現(xiàn) ：對(duì)于非門(mén)來(lái)說(shuō)，輸入和輸出呈現(xiàn)完全相反的關(guān)系，在真值表中體現(xiàn)為輸入為 1 時(shí)輸出為 0，輸入為 0 時(shí)輸出為 1，如表 3 所示。
表 3 非門(mén)真值表
基本邏輯門(mén)符號(hào)
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